서울시 송파구 법원로 128 문정 SK V1 GL메트로시티 C동 1320호 이니프로 교육장
10:00 ~ 17:00 (1일6시간, 총3일 18시간, 중식제공, 교재제공, 주차지원)
12명 (선결제순)
교육시작일 일주일전까지 웹에서 주문 및 결제를 완료 하시면 됩니다.
교육시작 일주일전에 교육진행여부를 결정합니다. (※ 교육진행 최소인원은 4명입니다.)
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현대 디지털 회로의 복잡도와 디자인 사이즈가 커짐에 따라 기존의 설계 방식으로는 고객의 요구를 만족시킬 수 없게 되어 HDL이라는 코딩기법을 이용하여 하드웨어를 설계하고 있습니다. 그래서 현재 95%이상의 칩은 HDL을 사용하여 개발되고 있습니다. HDL은 디지털 회로 설계자에게 필수가 되었습니다. 현재 가장 많이 사용하고 있는 HDL은 VHDL과 Verilog HDL이 있는데 그 중 Verilog HDL은 많이 사용하는 C언어와 거의 비슷한 문법을 가지고 있습니다. 그래서 C언어를 쓰던 엔지니어들이 선호하는 경향이 있습니다. 본 교육과정에서는 디지털 회로를 Verilog HDL로 설계를 하기 위한 과정입니다. Verilog HDL의 기본적인 문법 및 구현 방법 에서부터 고급 코딩 기법까지 익힌 후 실습용 FPGA 보드와 인텔툴인 Quartus를 사용하여 실습을 함으로써 몸에 익히는 과정을 포함하고 있습니다.
시 간 | 주 요 내 용 | 교육방법 |
---|---|---|
1일차 – Verilog 소개 |
|
이론 50% 실습 50% |
2일차 – 기본회로설계 및 응용 |
|
이론 40% 실습 60% |
3일차 – FSM설계 및 프로젝트 |
|
이론 30% 실습 70% |
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